Projektdaten für das ESY1B Praktikum im Sommersemester 2022
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Top.sv 1.3KB

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  1. `include "../spi_interface.v"
  2. `include "../fsm/Fsm.sv"
  3. `include "../Bus_if/Bus_if.sv"
  4. `include "../timer_port/timer_top.sv"
  5. module Top(
  6. input wire clk,
  7. input wire rst,
  8. input wire endOfConv,
  9. output wire LEDg,
  10. output wire LEDr,
  11. output wire AlarmAmpel
  12. );
  13. // Bus (Interface)
  14. Bus_if bus(.clk(clk));
  15. // SPI Interface
  16. // FSM
  17. Fsm fsm(
  18. .clk(clk),
  19. .inAlarmAmpel(bus.AlarmAmpel),
  20. .inDataValid(bus.DataValid),
  21. .inTasteAktiv(bus.TasteAktiv),
  22. .outAlarm_R(bus.Alarm_R),
  23. .outSendData(bus.SendData),
  24. .outTimerEN(bus.TimerEN)
  25. );
  26. // Parallelport
  27. parallelport parallelport1 (
  28. .inClk(clk),
  29. .inTimerMeas(bus.TimerMeas),
  30. .inEndOfConv(endOfConv),
  31. .inData(bus.Data),
  32. .outDataValid(bus.DataValid),
  33. .outData(bus.Data)
  34. );
  35. // FRAM-Controller
  36. // Timer
  37. timer timer1 (
  38. .inClk(clk),
  39. .inTaste(bus.Taste),
  40. .inEN(bus.TimerEN),
  41. .outReadTemp(bus.ReadTemp),
  42. .outTasteAktiv(bus.TasteAktiv)
  43. );
  44. // Ampelsteuerung
  45. led_top ampelsteuerung (
  46. .clk12M(clk),
  47. .rst(rst),
  48. .data_input(bus.Data),
  49. .data_valid(bus.DataValid),
  50. .RED(LEDr),
  51. .GRN(LEDg),
  52. .alarm(bus.AlarmAmpel)
  53. );
  54. assign AlarmAmpel = bus.AlarmAmpel;
  55. endmodule