sessleral71711 dcb19f11aa FSM initial commit

2022-05-31 12:45:24 +02:00

Code_FRAM_Speicher

FRAM

2022-05-19 17:02:44 +02:00

fsm

FSM initial commit

2022-05-31 12:45:24 +02:00

Source_FRAM_Controller

FRAM

2022-05-19 17:02:44 +02:00

BUS.PNG

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Description

Projektdaten für das ESY1B Praktikum im Sommersemester 2022

5 MiB

Languages

SystemVerilog 100%