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ESY1_Projekt_2023
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Alexander Mueller
2624055082
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2023-06-15 10:13:12 +00:00
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Dokumentation
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FRAM Controller
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2023-05-04 11:58:59 +00:00
FRAM_Speicher
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2023-05-04 11:58:19 +00:00
interface.sv
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2023-06-15 10:13:12 +00:00
README.md
Initial commit
2023-05-04 10:18:07 +00:00
Timer.sv
„Timer.sv“ hinzufügen
2023-06-15 10:06:31 +00:00
README.md
ESY1_Projekt_2023
Description
No description provided
Readme
3.8
MiB
Languages
SystemVerilog
95.9%
Tcl
2.8%
Stata
1.3%
