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FPGA_Projekt_Regler
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Tree: 1f4de14e3e
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FPGA_Projekt_Regler/StreckenSim_mitRegler/StreckeSim_counter_working/StreckeSim/Coraz7_Test.sim/sim_1/behav/xsim
Felix Stamm 1f4de14e3e Regler+Strecke Simulation läuft für Eingangswerte w > 100 Mio 2 years ago
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xsim.dir Regler+Strecke Simulation läuft für Eingangswerte w > 100 Mio 2 years ago
compile.bat Regler+Strecke Simulation läuft für Eingangswerte w > 100 Mio 2 years ago
compile.log Regler+Strecke Simulation läuft für Eingangswerte w > 100 Mio 2 years ago
elaborate.bat Regler+Strecke Simulation läuft für Eingangswerte w > 100 Mio 2 years ago
elaborate.log Regler und Strecke Zeit neu skaliert, Parameter als inputs ergänzt 2 years ago
pwm_test_behav.wdb Init mit PID-Regler 2 years ago
pwm_test_db.tcl Regler und Strecke Zeit neu skaliert, Parameter als inputs ergänzt 2 years ago
pwm_test_db_behav.wdb Regler+Strecke Simulation läuft für Eingangswerte w > 100 Mio 2 years ago
simulate.bat Regler+Strecke Simulation läuft für Eingangswerte w > 100 Mio 2 years ago
simulate.log Regler und Strecke Zeit neu skaliert, Parameter als inputs ergänzt 2 years ago
xelab.pb Regler und Strecke Zeit neu skaliert, Parameter als inputs ergänzt 2 years ago
xsim.ini Init mit PID-Regler 2 years ago
xsim.ini.bak Init mit PID-Regler 2 years ago
xvhdl.log Regler+Strecke Simulation läuft für Eingangswerte w > 100 Mio 2 years ago
xvhdl.pb Regler+Strecke Simulation läuft für Eingangswerte w > 100 Mio 2 years ago