kuntzschcl/ESY1_Projekt_2023
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hans 24a79c2647 spi aenderungen
2023-06-15 14:52:43 +02:00
Ampelansteuerung
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2023-06-09 10:25:15 +00:00
Dokumentation
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2023-05-04 11:59:42 +00:00
FRAM Controller
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2023-05-04 11:58:59 +00:00
FRAM_Speicher
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2023-05-04 11:58:19 +00:00
uebung_projekt
spi aenderungen
2023-06-15 14:52:43 +02:00
fram_interface.sv
fram_interface
2023-06-15 12:53:36 +02:00
interface.sv
„interface.sv“ ändern
2023-06-15 12:36:24 +00:00
README.md
Initial commit
2023-05-04 10:18:07 +00:00
Timer.sv
„Timer.sv“ hinzufügen
2023-06-15 10:06:31 +00:00
top_level.sv
„top_level.sv“ ändern
2023-06-15 12:34:33 +00:00
transcript
spi aenderungen
2023-06-15 14:52:43 +02:00

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ESY1_Projekt_2023

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3.8 MiB
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SystemVerilog 95.9%
Tcl 2.8%
Stata 1.3%