hauselthe74767/signal_processing_vorlage
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  • baa5aa4c74 FPGA programmiert master Brandl 2024-12-18 10:03:57 +01:00
  • c9ca4d965a Versuch 3 Hardware funktioniert Juhu! brandlfl78731 2024-12-18 09:18:47 +01:00
  • 509e01e501 Versuch 3 CRC Hardware vorlaeufig brandlfl78731 2024-12-11 11:26:50 +01:00
  • 118d08219e Versuch 3 CRC, Software fertig brandlfl78731 2024-12-04 11:19:36 +01:00
  • 45db9f89e2 Versuch 3 Software so halb brandlfl78731 2024-11-27 11:25:02 +01:00
  • de8d181dde Versuch 2 Hardware funktioniert brandlfl78731 2024-11-27 10:19:31 +01:00
  • cfe1e2927c Versuch 2 Hardware vorlaeufig brandlfl78731 2024-11-20 11:32:11 +01:00
  • 03a4e64337 Versuch 2 Software funktioniert brandlfl78731 2024-11-20 10:33:56 +01:00
  • 00fd3908d8 Versuch add abgeschlossen. Funktioniert auch praktisch! brandlfl78731 2024-11-20 09:44:18 +01:00
  • 641e3a6945 Sollte theoretisch funktionieren brandlfl78731 2024-11-20 09:29:10 +01:00
  • c4491f89e0 Sollte theoretisch funktionieren - mit muell brandlfl78731 2024-11-20 09:27:56 +01:00
  • f5940ef807 Task4 hardware add.vhd vorlaeufig brandlfl78731 2024-11-13 11:19:20 +01:00
  • b1adcc892a Task4 software add.c brandlfl78731 2024-11-13 09:17:03 +01:00
  • 0d1b73e3e0 Initial commit Johannes Kutning 2023-10-31 07:47:27 +01:00