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ecd6f16dbe merge konflikt behoben 2022-06-14 12:25:25 +02:00
6a72019f25 Initalized top level design 2022-06-14 12:25:19 +02:00
53868c67fd Added Bus_if and fsm to top level design 2022-06-14 12:22:52 +02:00
6ab278694e Initalized top level design 2022-06-14 12:22:52 +02:00
9ffb72cf97 Screenshots from RADIANT --> how to create SPI module with radiant 2022-06-14 09:59:23 +00:00
72c964475f Screenshots from RADIANT --> how to create SPI module with radiant 2022-06-14 09:58:24 +00:00
d2aa8277c7 spi_interface dateien 2022-06-14 11:56:42 +02:00
c46a1c3b33 add "spi_interface_portsI()" (beginning of document) 2022-06-14 09:42:25 +00:00
200a989683 Added modport for timer 2022-06-14 11:23:54 +02:00
613bffbcfc Added modport in Bus_if for Fsm 2022-06-14 11:03:41 +02:00
19177edb3f Merge branch 'main' of https://git.efi.th-nuernberg.de/gitea/kuntzschcl/ESY1_Projekt_2022 2022-06-14 11:01:22 +02:00
0ecac8324e Timer and Port source 2022-06-14 11:00:38 +02:00
37989e5bc1 Ampel
Ampelsteuerung mit toplevel_verbindungen sowie normaler TB und random TB
2022-06-14 08:59:08 +00:00
ad550a9ac6 Created bus as interface 2022-06-14 10:49:23 +02:00
e8af8d04c8 Merge branch 'main' of https://git.efi.th-nuernberg.de/gitea/kuntzschcl/ESY1_Projekt_2022 2022-06-14 09:51:22 +02:00
ca1f1b531c Dateien hochladen nach „“ 2022-06-02 07:39:05 +00:00
7b858e7068 Dateien hochladen nach „“ 2022-06-02 07:38:28 +00:00
71b0458554 FSM mit 2 States erstellt und getestet 2022-06-02 09:26:16 +02:00
700350608a Dateien hochladen nach „“ 2022-05-31 10:58:28 +00:00
48610eeb8c Added Clk_generator 2022-05-31 12:50:05 +02:00
dcb19f11aa FSM initial commit 2022-05-31 12:45:24 +02:00
937da8ec22 Dateien hochladen nach „“ 2022-05-31 10:14:56 +00:00
1cf5934374 „memory.txt“ löschen 2022-05-19 15:04:29 +00:00
667101d7fd „SPI_FRAM_Module.sv“ löschen 2022-05-19 15:04:22 +00:00
kuntzschcl
08300af99a FRAM
added FRAM sources
2022-05-19 17:02:44 +02:00
f691d1318a Dateien hochladen nach „“ 2022-05-19 14:51:31 +00:00
kuntzschcl
fec9cd1ae0 Create FM25CL64B.pdf 2022-05-19 16:29:56 +02:00